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AMD prépare un nouveau socket baptisé G34 pour 2010, certainement pour ses prochains processeurs à huit et douze cœurs, explique le site DailyTech.
Cette nouvelle chaussette G34 arrivera sur le marché avec deux processeurs AMD 45 nm de seconde génération. Le premier sera l'octocœur « Sao Paolo », regroupant deux quadricœurs natifs juxtaposés, selon les premières informations officieuses d'AMD. Le second processeur pourrait bien être un CPU à douze cœurs, baptisé « Magny-Cours ».
Ces puces seront dotées de quatre bus HyperTransport 3, de 12 Mo de cache L3 et de 512 Ko de cache L2 par cœur. Ces deux processeurs pourraient aussi gérer la mémoire DDR3 de 800 à 1600 MHz sur un contrôleur quadricanal. Pour rappel, le futur Nehalem d'Intel gérera la DDR3 sur un contrôleur tricanal.
Le diagramme exhibant le socket G34 révèle l'existence de 1974 broches, un nombre qui augmente donc considérablement face au plus gros socket actuel d'AMD, le LGA1207 à 1207 broches. Et ceci est certainement dû à la présence de quatre bus HyperTransport et quatre canaux de mémoire vive à connecter.
Ces bus Hypertransport multiples sont l'espoir même d'AMD pour l'avenir : dans une configuration quadriprocesseur, chaque puce sur socket G34 dédiera l'un de ses quatre bus HT à chacun des trois autres processeurs, le dernier bus HT restant sera dédié à la plateforme Torrenza d'AMD.
Ce système serait alors le meilleur moyen de connecter un processeur à un GPU ou toute autre puce de calcul intense, comme le Cell, explique AMD. C'est d'ailleurs déjà le cas au sein du plus gros supercalculateur du monde, le Roadrunner d'IBM.
Cette nouvelle chaussette G34 arrivera sur le marché avec deux processeurs AMD 45 nm de seconde génération. Le premier sera l'octocœur « Sao Paolo », regroupant deux quadricœurs natifs juxtaposés, selon les premières informations officieuses d'AMD. Le second processeur pourrait bien être un CPU à douze cœurs, baptisé « Magny-Cours ».
Ces puces seront dotées de quatre bus HyperTransport 3, de 12 Mo de cache L3 et de 512 Ko de cache L2 par cœur. Ces deux processeurs pourraient aussi gérer la mémoire DDR3 de 800 à 1600 MHz sur un contrôleur quadricanal. Pour rappel, le futur Nehalem d'Intel gérera la DDR3 sur un contrôleur tricanal.
Le diagramme exhibant le socket G34 révèle l'existence de 1974 broches, un nombre qui augmente donc considérablement face au plus gros socket actuel d'AMD, le LGA1207 à 1207 broches. Et ceci est certainement dû à la présence de quatre bus HyperTransport et quatre canaux de mémoire vive à connecter.
Ces bus Hypertransport multiples sont l'espoir même d'AMD pour l'avenir : dans une configuration quadriprocesseur, chaque puce sur socket G34 dédiera l'un de ses quatre bus HT à chacun des trois autres processeurs, le dernier bus HT restant sera dédié à la plateforme Torrenza d'AMD.
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Rédigée par le jeudi 17 juillet 2008 à 11h17 (14600 lectures)
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